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EMC

デカップリングコンデンサ EMC選定

EMC電源デカップリングのためのコンデンサインピーダンスと自己共振周波数を計算します。

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公式

Xc=1/(2πfC),fSRF=1/(2πLC)Xc = 1/(2πfC), f_SRF = 1/(2π√LC)
Cキャパシタンス (F)
Lパッケージインダクタンス (パッケージにより異なります) (H)

仕組み

デカップリングコンデンサのEMCカリキュレータは、CISPR 32準拠、FPGA PDN設計、およびスイッチングレギュレータのノイズ低減に不可欠な伝導エミッション抑制の最適な値と配置を決定します。EMCのエンジニアはこれを利用して、エミッションを悪化させる可能性のある共振を回避しながら、特定の周波数で20〜40dBのノイズ減衰を実現しています。

ヘンリー・オットの「EMCエンジニアリング」と村田製作所のアプリケーションノートによると、コンデンサのインピーダンスは自己共振周波数(SRF)よりZ = sqrt((1/(2 x pi x f x C))^2 + ESR^2)、SRFよりZ = 2 x pi x f x ESLです。0.7 nH ESL (0402 パッケージ) を搭載した 100 nF MLCC は f_SRF = 1/ (2 x pi x sqrt (0.7e-9 x 100e-9)) = 19 MHz で共振します。19 MHz を超えると、コンデンサは誘導性になり、デカップリング効果が失われます。

IPC-2152とスミスの「高速デジタル・システム設計」によると、複数のコンデンサ値を並列に接続すると、重複する低インピーダンス帯域が生成されます。10uFはDC-1 MHzをカバーし、100nFは1〜30MHzをカバーし、10nFは30〜100MHzをカバーし、1nFは100〜300MHzをカバーします。各値は、インピーダンスがESR(MLCCの場合は通常10〜50mオーム)に等しいSRF付近の周波数を処理します。

Johnson/Grahamによると、配置は非常に重要です。コンデンサとIC電源ピンの間のトレースがmmになるごとに約1nHのインダクタンスが増加し、有効なSRFが下方にシフトし、高周波デカップリングが低下します。ICから10mm離れたコンデンサには10 nHのESLが付加されるため、5MHzを超えると直接接続した場合と比較して効率が20dB低下します。

計算例

問題:200 MHz FPGA のデカップリングを設計すると、180 MHz で CISPR 32 の制限値を 12 dB 上回る伝導エミッションが示されます。現在の PDN には 10 uF のバルク・コンデンサしかありません。

オットあたりのソリューション: 1.問題の周波数:180 メガヘルツ — 10 uF (約 500 kHz) および 100 nF (約 19 メガヘルツ) の SRF を上回る 2.必要な減衰量:180 メガヘルツで 12 dB + 6 dB マージン = 18 dB 3.180 MHz 用コンデンサ:180 MHz 付近の SRF が必要です。C = 1/ (4 x pi^2 x f^2 x L) = 1/ (4 x pi^2 x (180e6) ^2 x 0.7e-9) = 1.1 nF 4.1 nF 0402 MLCC (SRF 約 190 メガヘルツ、ESR 約 30 ミリオーム) を選択します。 5.直流時のインピーダンス:A = ESR = 30 ミリオーム 6.デカップリング効果:PDN インピーダンスが 180 MHz で 3 オームだった場合、コンデンサを追加すると 30 ミリオームに減少します。— 改善 = 20 x log10 (3/0.03) = 40 dB 7.4 個の 1 nF コンデンサを並列に使用してください。Z = 30/4 = 7.5 ミリオームです。

配置:同じ層の FPGA 電源ピンから 2 mm 以内にある 1 nF コンデンサ (デカップリングパスにビアなし)。BGA の四辺すべてに追加します。

実践的なヒント

  • FPGA デカップリングには「1-2-4 ルール」を使用してください。インテル/ザイリンクスによると、レールあたり 1 x 10 uF バルク、電源ピンクラスタあたり 2 x 100 nF、ダイエリア全体に分散された 4 x 10 nF です。100 kHz から 200 MHz までフラットなインピーダンスを提供します。
  • コンデンサをIC電源ピンと同じ層に配置します。Smithによると、デカップリング経路のビアは1〜2nHのインダクタンスを追加します。ビア・イン・パッドを備えたBGAの下の裏側コンデンサは、インダクタンスの増加がほぼゼロになります。
  • VNAでPDNインピーダンスを測定して共振を特定します。Sandlerによると、シミュレーションの精度は+/ -30%です。実際の測定では、特定の周波数でインピーダンスのピークを引き起こすプレーンとコンデンサの間の反共振が明らかになっています。

よくある間違い

  • 高周波ノイズには大きなコンデンサ (10 uF) のみを使用します。Ott あたり 10 uF の SRF は、約 500 kHz です。1 MHz を超えると、コンデンサは誘導性になり、インピーダンスが増加します。100 MHz を超える周波数での放射には、SRF の大きい 1 ~ 10 nF のコンデンサが必要です。
  • パッケージのインダクタンスを無視すると、村田製作所によると、0805パッケージのESLは1.2nHであるのに対し、0402のESLは0.7nHです。パッケージが大きいほどSRFは低くなります。0805では100nFが14MHzで共振するのに対し、0402では19MHzで共振します。周波数効率を最大限に高めるには、最小のパッケージを使用してください。
  • コンデンサをICから遠くに配置すると、Johnson/Grahamによると、10mmのトレースで10 nHが追加されます。これは、0402から大型のスルーホールコンデンサに変更するのと同じです。インダクタンスを最小限に抑えるには、ビアをプレーンに接続して電源とグランドをコンデンサの真下に配線するか、ビアインパッドを使用してください。

よくある質問

ムラタのガイドラインによると、(1)電源レールあたり10〜100uFのバルク(DC-1 MHz)、(2)電源ピンあたり100nF(1~30MHz)、(3)50MHz(30〜100MHz)を超えるスイッチングの場合は10nF、(4)200MHz以上のクロック(100〜300MHz)の場合は1nF。マイクロコントローラの場合:通常、電源ピンあたり 100 nF で十分です。FPGA の場合:インテル/ザイリンクスの設計ガイドに記載されている数量でフルレンジが必要です。
オット当たり:10nFのSRFは100nF(約19メガヘルツ)よりもSRF(0402では約60メガヘルツ)が高い。50 MHz から 150 MHz のノイズを抑制するには、10 nF の方がより効果的です。というのも、その範囲ではまだ容量性があるからです。DC-30 MHz フィルタリングには 100 nF を使用し、30 ~ 100 MHz には 10 nF を使用し、100 ~ 300 MHz には 1 nF を使用します。複数の値が全スペクトルをカバーします。
SRFではそうです。村田製作所によると、コンデンサのインピーダンスは自己共振周波数でのESRに等しくなります。X5R/X7RセラミックのESRは10〜50ミリオームで、タンタルのESRは50〜500ミリオームです。SRFでは、低ESRセラミックの方がタンタルよりも10~20dB優れたデカップリングが得られます。SRFより上でも下でも、ESRはそれほど重要ではありません。EMCのデカップリングにはX5R/X7R MLCCを使用し、タンタルはバルクストレージにのみ使用してください。
インテル/ザイリンクスのガイドラインによると、単純なMCUには電源ピンごとに1つのコンデンサが必要です。複雑なFPGAには、消費電力とスイッチング速度に応じて、合計で50〜200個のコンデンサが必要です。経験則では、対象となる周波数のスイッチング電流1mAあたり1コンデンサが必要です。コア電流が2Aの100MHzのFPGAの場合、最低でも約20~40個の高周波デカップリング・コンデンサが必要です。
はい。スミスによると、コンデンサのESLとプレーンキャパシタンスの間の反共振により、特定の周波数でどちらか単独の場合よりも10〜100倍高いインピーダンスピークが発生する可能性があります。反共振がノイズ高調波と一致すると、その周波数での放射が悪化します。解決策:共振が重なるように複数のコンデンサ値を使用し、特定の反共振が問題になる場合は、直列RCスナバでダンピングを追加してください。

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