SMPS 벅 컨버터 안정성: 몬테카를로 튜닝
SMPS 제어 루프 안정성 분석기를 사용하여 12V→5V 벅의 위상 마진, 게인 마진 및 크로스오버 주파수를 확인하는 방법을 단계별로 설명합니다.
목차
“충분히 좋은” 구성 요소 값의 문제점
정상 상태 계산을 완료했습니다.12V→5V, 2A 벅 컨버터는 올바른 출력 전압을 생성하고, 인덕터 전류 리플은 사양 내에 있으며, 출력 커패시터는 리플 전압을 50mV 미만으로 유지합니다.종이 상으로는 깨끗해 보입니다.
하지만 문제는 Type III 보정기를 사용한 전압 모드 제어에는 7개의 조정 가능한 파라미터가 있고 정상 상태 분석을 통해서는 루프 안정성에 대해 전혀 알 수 없다는 것입니다.DC 동작점 계산에서 완벽해 보이는 컨버터가 과도 부하 단계에서 벨처럼 울리거나 격렬하게 진동하거나 제대로 조절하지 못하는 것을 본 적이 있습니다.보드를 스핀하기 전에 위상 마진을 확인하고 마진을 늘려야 합니다.더 중요한 것은 커패시터가 공칭 값에서 20% 이상 떨어졌을 때 루프가 어떻게 동작하는지 알아야 한다는 것입니다. 그럴 것이기 때문입니다.
이것이 바로 SMPS 제어 루프 안정성 분석기가 설계된 시나리오입니다.이는 마지막 보드 개정 이전에 사용했으면 하는 도구 중 하나입니다.
노미널 디자인 설정
대상 설계는 IoT 게이트웨이 파워 레일로, 입력 12V, 출력 5V, 최대 부하 2A입니다.LC 필터는 표준 규격품을 사용했습니다. 이렇게 간단한 용도로는 특이한 부품을 지정할 필요가 없기 때문입니다.도구에 다음을 입력하세요.
| 매개변수 | 값 |
|---|---|
| 토폴로지 | 벅 |
| 제어 모드 | 전압 모드 |
| V_in | 12V |
| V_OUT | 5 V |
| 아이_아웃 | 2 A |
| L | 47µH |
| C | 220 µF |
| ESR | 50mΩ |
| F_SW | 100 킬로헤르츠 |
| V_램프 | 1.0V |
| 보정기 | 타입 III |
| K | 2000 |
| f_z1 | 500 헤르츠 |
| f_z2 | 1500헤르츠 |
| f_p1 | 20 킬로헤르츠 |
| f_p2 | 50 킬로헤르츠 |
LC 쌍극과 보정기 배치가 중요한 이유
LC 출력 필터는 다음과 같은 위치에 쌍극을 생성합니다.
500Hz에서 f_z1을, 1500Hz에서 f_z2를 배치하면 1.57kHz에서 LC 쌍극이 무너집니다.이는 무작위가 아닙니다. 500Hz에서 0이 되면 크로스오버 주파수 바로 주변에서 최대 위상 부스트에 도달할 수 있을 만큼 충분히 일찍 위상이 추가되기 시작합니다.영점을 LC 극에 너무 가깝게 놓으면 제 시간에 충분한 위상 부스트를 얻을 수 없습니다.너무 멀리 떨어져 있으면 필요하지 않은 곳에서 위상 부스트를 낭비하게 됩니다.
이렇게 생각해 보세요. LC 필터는 위상 마진을 파괴하려 하고, 보정기 0은 반격하기 위해 존재합니다.전투가 실제로 벌어지는 곳에 배치하는 것이 좋습니다.
몬테카를로 달리기: 진짜 문제가 나타나는 곳
명목상의 안정성은 필요하지만 충분하지는 않습니다.실제 프로덕션 보드는 허용 오차가 있는 부품을 사용하며, 이러한 허용 오차는 세심하게 튜닝한 루프를 완전히 망칠 수 있는 방식으로 누적됩니다.몬테카를로 섹션을 구성하세요.
| 매개변수 | 값 |
|---|---|
| MC 트라이얼 | 20만 |
| 인덕터 허용 오차 | ± 20% |
| 커패시터 허용오차 | ± 20% |
| ESR 허용오차 | ± 50% |
| 부하 허용오차 | ± 30% |
| 분포 | 가우스 |
문제는 ESR과 상호작용하는 출력 커패시터 허용오차입니다.허용 오차가 -20% 인 220µF 커패시터는 176µF가 되며, 이로 인해 LC 이중극이 최대 약 1.75kHz까지 이동합니다.자체 허용 오차 극한의 낮은 ESR과 결합하면 위상 강하가 심화되고 보정기 제로가 더 이상 이를 효과적으로 지지하지 못합니다.세심하게 배치한 0이 이제 잘못된 위치에 있어 위상 마진이 무너집니다.
이것이 바로 명목상의 가치에 맞춰 디자인하고 그것을 하루라고 부를 수 없는 이유입니다.실제로 보드에 있는 부분은 스프레드시트와 일치하지 않으므로 전체 범위에서 루프가 안정적으로 유지되어야 합니다.
해결 방법: 커패시터 허용 오차 강화
몬테카를로 섹션에서 커패시터 오차를 ± 20% 에서 ± 10% 로 변경하고 다시 실행하십시오 (나머지는 동일하게 유지).수율이 약 96% 까지 올라갑니다.위상 마진 히스토그램의 왼쪽 꼬리가 사라집니다. 최악의 경우 시험 상태가 40°를 넘어섰고, 중앙값 마진은 51°입니다.
실제로 이는 표준 전해질 대신 알루미늄 폴리머 또는 X7R MLCC 커패시터를 지정하는 것을 의미합니다.단일 220µF 커패시터의 비용 델타는 일반적으로 몇 센트 (합리적인 수량으로 따지면$0.15 instead of 10K on a re-spin to fix a stability issue that could have been prevented with a $0.07 BOM 증가를 지출하는 것을 본 적이 있습니다.
그렇게 보면 당연한 일이지만, 몬테카를로의 수익률을 확인하려는 사람이 아무도 없었기 때문에 가능한 가장 저렴한 상한선으로 얼마나 많은 설계가 진행되는지 놀라게 될 것입니다.
게인 플롯에서 주목해야 할 사항
이 툴의 보드 플롯은 SPICE에서 놓치기 쉬운 몇 가지 사항을 즉시 확인할 수 있게 해줍니다.제가 항상 확인하는 내용은 다음과 같습니다.
오른쪽 평면 제로 (RHPZ) 는 전압 모드 벅 컨버터 (부스트 및 플라이백 토폴로지에서 나타남) 에서 모델링되지 않았지만 툴은 여기서는 이를 정확하게 제외합니다.부스트 토폴로지로 전환하는 경우 RHPZ가 달성 가능한 크로스오버 주파수를 제한하는지 확인하십시오.부하 전류가 증가하면 RHPZ도 낮아지므로 주의하지 않으면 크로스오버 주파수에 큰 영향을 미칠 수 있습니다. 크로스오버 근처에서 게인이 최고조에 달합니다. K를 너무 높게 설정하면 게인 곡선이 크로스오버 직전에 최고점이 됩니다.툴의 게인 마진 메트릭은 이 문제를 직접 파악합니다. 게인 마진이 6dB 미만으로 떨어지면 K 이하로 떨어집니다. 저는 보통 최소 10dB를 목표로 삼아 숨을 쉴 수 있는 여유를 확보하는 것을 목표로 합니다.게인 피킹은 시뮬레이션에서는 사소해 보이지만 실제 하드웨어에서는 가청 울림을 유발하는 요인 중 하나입니다. ESR 제로. 220µF 커패시터의 50mΩ ESR은 다음과 같은 위치에 0을 설정합니다.ESR zero에 알루미늄 폴리머 또는 전해 캡을 사용하여 설계하는 경우 BOM 메모에 이를 기록해 두어야 합니다.나중에 귀하 (또는 비용 절감을 담당하는 다른 엔지니어) 는 특정 캡을 선택한 이유를 설명해 주셔서 감사할 것입니다.
요약
공칭 설계는 안정성 검사를 통과했지만 실제 부품 허용 오차를 사용한 Monte Carlo 분석에서는 45° 위상 마진 임계값에서 29% 의 고장률을 보였습니다.이는 어떤 생산 설계에서도 용납할 수 없는 수치입니다.출력 커패시터 사양을 ± 20% 에서 ± 10% 로 강화하면 다른 설계 변경 없이 수율이 96% 이상으로 높아집니다.
시뮬레이션에는 몇 초 정도 걸립니다.보드를 다시 스핀하는 데에는 몇 주, 수천 달러가 소요됩니다.거버를 보내기 전에 안정성 분석기를 사용하세요.저는 이 교훈을 두 번 이상 어렵게 배웠는데, 이제 최소 수천 번의 몬테카를로 시험 사용을 거치지 않고는 전원 공급 장치 설계를 포기하지 않을 수 있을 것입니다.덕분에 불안정한 컨버터를 여러 번 출하하지 않아도 되었습니다.
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