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PCBビアカリキュレータ

インピーダンス、キャパシタンス、インダクタンス、電流容量、アスペクト比、およびDFM警告を使用してPCBを計算します。スルーホールビアとブラインド/ベリードビアをカバーします。

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公式

C_{via} \approx \frac{0.0554\,\varepsilon_r\,T\,d}{D-d}\ \text{pF},\quad L_{via} \approx 0.2h\left(\ln\frac{4h}{d}+0.5\right)\ \text{nH}

参考: IPC-2141A; Howard Johnson "High-Speed Signal Propagation"

TBoard thickness (mm)
dVia drill diameter (mm)
DPad diameter (mm)
εᵣDielectric constant
hVia height (= board thickness) (mm)

仕組み

ビアインピーダンスの計算は、垂直相互接続アクセス(VIA)構造の電気特性を表す高周波PCB設計において非常に重要です。ビアのインピーダンスは、基板の直径、パッドサイズ、誘電率など、いくつかの重要な幾何学的パラメータに依存します。基礎となる物理特性には、円筒状の導体を通る電磁波の伝搬が関係しており、信号伝送はビアの物理的寸法と周囲の材料特性の影響を受けます。インピーダンスの変動は信号経路の不連続性によって発生し、複雑な電子回路では反射、信号の歪み、および潜在的な高周波性能の低下を引き起こす可能性があります。

計算例

一般的なFR-4基板のビアを次のパラメータで考えてみましょう。ビア外径 (D) = 0.5 mm、インナービア径 (d) = 0.2 mm、誘電率 (δr) = 4.3、ビア厚さ (T) = 1.2 mm。提供されている式を使用して、まずビアインピーダンスを計算します。87·ln (1.9·0.5/0.2) /√4.3 ≈52.3オームです。ビアの寄生容量は1.41·4.3·1.2· (0.2) ²/ (0.5) ²-(0.2) ²) ≈0.76 pFと計算されます。同時に、ビアのインダクタンスは5.08·1.2· [ln (4·1.2/0.2) +1] ≈6.42 nHと計算されます。

実践的なヒント

  • 正確なインピーダンスの計算には、必ず実際の製造ビア寸法を使用してください。
  • 多層設計でシグナルインテグリティを向上させるには、ビアステッチの使用を検討してください
  • 電磁界シミュレーションツールによる理論計算の検証

よくある間違い

  • 高周波インピーダンスを計算する際のビアアスペクト比の無視
  • 異なる基板材料間で均一なビアインピーダンスを想定
  • 高速設計における寄生容量とインダクタンスの無視

よくある質問

一般に、ビアの直径が大きいとインピーダンスが低下して寄生容量が増加しますが、直径が小さいとインピーダンスが増加し、容量結合が減少します。
正確なビアインピーダンス計算により、信号の反射を防ぎ、電磁干渉を最小限に抑え、高速デジタル回路とRF回路のシグナルインテグリティを確保します。
ビアインピーダンスは、形状パラメータを最適化し、適切な基板材料を使用し、高度なビア設計技術を実装することで最小限に抑えることができます。
基板材料が異なれば誘電率も異なり、インピーダンス、キャパシタンス、および全体的な信号伝送特性に直接影響します。
これらの式は、ほとんどの実用的な周波数の近似値が得られますが、非常に高い周波数のアプリケーションでは、より高度な電磁モデリングが必要になる場合があります。

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