10 Gbps SerDesのアイダイアグラム分析:スピン前にチャネルを検証
ある基板設計者は、2 つのコネクタを備えた 20 cm FR-4 トレースに 10 Gbps の SerDes レーンを配線します。製造に取り掛かる前に、Sパラメータ・データとアイ・ダイアグラム・シミュレーションを使用して、障害が発生しているチャネルを把握する方法を学びましょう。
レイアウトツールを信頼する場合の問題
10 Gbps SerDes レーン (PCIe 第 3 世代または XAUI リンク) を、2 つのエッジマウント SMA コネクタを備えた 20 cm FR-4 トレースを介してルーティングしました。DRC は緑色で、紙の上ではインピーダンスは 100 Ω の差で、トレースはまっすぐでビアは最小限です。問題ないはずですよね?
たぶん。そうではないかもしれない。10 Gbps のナイキスト周波数は 5 GHz で、FR-4 は、特定のラミネートグレードにもよりますが、その周波数で約 0.5~1 dB/cm の損失が発生します。20 cm 走ると、コネクタに触れる前に挿入損失が 10 ~ 20 dB になります。それぞれ 1 ~ 2 dB のコネクタを 2 つ追加すると、ナイキストでの総損失が 12 ~ 24 dB のチャネルになります。これは、目を完全につぶすほどです。
基板を回転させずに確実に知る唯一の方法は、測定したSパラメータからアイダイアグラムをシミュレートすることです。
必要なもの:2 ポート S パラメータファイル
アイダイアグラムツールを開く前に、VNA でチャネル応答をキャプチャしてください。ファイルは次のようになっているはずです。
-フォーマット: タッチストーン .s2p (2 ポート) -周波数範囲: 10 MHz~少なくとも 15 GHz (3 倍のデータレートが目安です) -ポイント: 1001 以上、対数間隔でもリニア間隔でも動作可能 -ポート・リファレンス・インピーダンス: 50 Ω シングルエンド (差動ペアの100 Ω差動には、4ポートの.s4p、または混合モード S21 の 2 ポート測定が必要です)
シミュレーションを実行する前に確認しておくべき主なパラメーター:
| S パラメーター | それが教えてくれること | 標準上限 (10 Gbps) |
|---|---|---|
| 5 GHz で S21 マグニチュード | ナイキストでの挿入損失 | -15 dB より優れている |
| DC—5 GHz での S11 マグニチュード | リターンロス/インピーダンスのミスマッチ | -10 dB より優れている |
| グループ遅延変動 | シンボル間干渉リスク | 50 ps 未満 pk-pk |
アイダイアグラムツールのセットアップ
.s2p ファイルを [アイダイアグラムツール] (/tools/eye-diagram) にアップロードし、以下のパラメーターを設定します。
| パラメーター | 値 | 理由 |
|---|---|---|
| データレート | 10e9 ビット/秒 (10 Gbps) | SerDes リンクレートに一致 |
| PRBS の長さ | PRBS-15 | BER テストの標準。ISI に負荷をかけるのに十分な長さ |
| UI あたりのサンプル数 | 64 | 過剰な計算を行わずに優れた時間分解能 |
| 入力電圧スイング | 800 mVpp 差動 | 標準的な SERDES TX スイング |
| 立ち上がり/立ち下がり時間 | 35 ps (10 ~ 90%) | 10G TX ドライバの標準値 |
結果を読む:オープンとクローズ
10 Gbps の 健康な目 なら以下のことが分かるはずです。
「MATHBLOCK_0」
「マスブロック_1」
ツールはこれらの数値を直接報告します。大まかな目安としては:
| 目の高さ | 目の幅 | 評決 |
|---|---|---|
| > 200 mV | > 0.5 UI | パス — 快適なマージン |
| 100—200 mV | 0.35—0.5 UI | マージナル — イコライゼーションを使用 |
| < 100 mV | < 0.35 UI | 失敗 — チャネルに損失が多すぎる |
目を閉じているときの対処法
オプション 1: トレース長を短くします。 最も簡単な解決方法。20 cm ではなく 12 cm に配線を変更できれば、約 4 ~ 8 dB の挿入損失を回復できます。再シミュレーションを実行して確認してください。 オプション2: 低損失ラミネートに切り替えます 標準のFR-4からIsola 370HRやパナソニックMegtron 6などの中損失ラミネートに移行すると、5 GHzでの損失が30~ 50% 削減されます。[制御インピーダンス計算ツール] (/calculators/PCB/制御インピーダンス) は、新しいスタックアップ寸法が100Ωの目標値を満たしていることを確認するのに役立ちます。 オプション 3: CTLE または DFE イコライザーを追加 ほとんどの 10G SerDes PHY には、ピーキングを調整できる連続時間リニアイコライザー (CTLE) が搭載されています。5 GHz でピーキングが 6 dB の CTLE であれば、挿入損失が最大 −22 dB のチャンネルをレスキューできます。CTLE 伝達関数を適用してシミュレーションを再実行し、イコライズされたアイを確認します。 オプション 4: コネクタの埋め込みを解除 VNA 測定に、最終設計では使用しないフィクスチャ・ローンチやコネクタ・パッドが含まれている場合は、それらの埋め込みを解除します。1 dB の人工的な損失回復でも、わずかな目がパスゾーンに移動する可能性があります。ビア・スタブ・レゾナンスに関する注意事項
Sパラメータシミュレーションでは捕捉できるがレイアウトチェックでは完全に見落とされる故障モードの1つが、スタブレゾナンスによるものです。1.6 mm 基板の 0.8 mm スタブ付きスルーホールビアは、おおよその位置で共振します。
「マスブロック_2」
これは 5 GHz をはるかに超えているので、標準ビアでも問題ありません。しかし、3.2 mm のスタブ (太いバックプレーンの真ん中に配線する場合に一般的) は 12 GHz 付近で共振するため、目を見張るような切り欠きが加わります。[ビア・スタブ・レゾナンス・カリキュレータ] (/calculators/pcb/ビア・スタブ・レゾナンス) は、Sパラメータをキャプチャする前にこのことを知らせてくれます。
ファイルを Fab に送信する前に
アイダイアグラムツールは、直感的なレイアウトチェックを定量的な合否判定に変えます。測定した.s2pをアップロードし、リンクパラメータを入力して、目の高さと目の幅という2つの数値を確認します。両方がグリーンゾーンにある場合は、コミットしてください。そうでない場合は、ボードスピンにお金をかける前に、どちらのノブを回すべきかが正確にわかります。
[アイダイアグラムシミュレーションを実行する] (/tools/アイダイアグラム)
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