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Calculadora de Rizado de Regulador Conmutado

Calcula la tensión de rizado de salida de reguladores conmutados buck y boost.

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Fórmula

ΔIL=(Vin−Vout)×D/(L×f),ΔV≈√(ΔVC2+ΔVESR2)ΔI_L = (V_in − V_out) × D / (L × f), ΔV ≈ √(ΔV_C² + ΔV_ESR²)
D— Ciclo de trabajo
L— Inductancia (H)
f— Frecuencia de conmutación (Hz)
C— Capacitancia de salida (F)
ESR— Resistencia en serie equivalente (Ω)

Cómo Funciona

La calculadora de ondulación del regulador de conmutación determina los requisitos de ondulación de voltaje de salida, ondulación de corriente del inductor y capacitores para los diseños de SMPS, lo que es esencial para el suministro de energía de carga digital, los sistemas de señal mixta y el cumplimiento de EMC. Los ingenieros de electrónica de potencia, los diseñadores de FPGA y los desarrolladores de electrónica automotriz utilizan esta herramienta para cumplir con las estrictas especificaciones de ondulación. Según los «Fundamentos de la electrónica de potencia» de Erickson & Maksimovic, la ondulación de la tensión de salida tiene dos componentes: capacitiva ( (ΔVc = ΔIL/(8×fsw×Cout)) ESR) y basada en ESR ( (ΔVesr = ΔIL × ESR). En el caso de los condensadores cerámicos con una ESR inferior a 10 mΩ , predomina la ondulación capacitiva; en el caso de los electrolíticos de aluminio con un ESR de 50-500 mΩ , predomina la ondulación ESR. La nota de aplicación de TI sobre el SLVA630 especifica que la corriente inductora Ripple ΔIL = vOut× (1-D)/(FSW×L) es una corriente por inductor que normalmente alcanza entre el 20 y el 40% de la corriente de carga continua. Los procesadores modernos requieren una ondulación inferior a 10 mV para evitar la degradación del margen temporal. El Intel VR14 especifica una tolerancia estática de ±5 mV y una tolerancia transitoria de ±25 mV para los raíles de núcleo de 1,0 V. Según la guía de aplicación de los condensadores Murata, las cerámicas X5R/X7R pierden entre un 50 y un 80% de capacitancia a una tensión de corriente continua nominal; para calcular la ondulación, reduzca siempre los valores de los condensadores cerámicos entre 2 y 3 veces.

Ejemplo Resuelto

Diseñe un convertidor reductor de 12 V a 1,0 V para una alimentación de núcleo FPGA de 20 A con una ondulación de <10 mV. Paso 1: Definir la ondulación del inductor con un objetivo del 30% de Iout: ΔIL = 6 A p-p. A 500 kHz, D = 1/12 = 0,0833. L = 1,0 × (1-0,0833)/(500 k× 6) = 305 nH. Utilice 330 nH (Vishay IHLP-5050). Paso 2: Calcular el requerimiento de condensador para 10 mV. Ondulación capacitiva: Cout_min = 6/ (8×500k×0,01) = 150 µF. Paso 3: Seleccione los condensadores: utilice cerámicas X5R de 10 × 22 µF/6,3 V (220 µF nominales, 120 µF efectivos después de la reducción de polarización de corriente continua). Contribución a la ESR: 10 casquillos paralelos = 0.3 mΩ Efectivo. ΔVesr = 6 A × 0.3 mΩ = 1.8 mV. Ondulación total = √(8² + 1.8²) ≈ 8.2 mV (dentro de las especificaciones). Paso 4: Verificar la respuesta transitoria: para un paso de carga de 15 A cada 100 ns: ΔV = L×ΔI/Vout = 330 nH × 15/1,0 = tiempo de caída de 4,95 µs. Agregue un condensador a granel de 330 µF para un flujo transitorio de <50 mV.

Consejos Prácticos

  • ✓Según la guía de diseño de Intel VR, utilice la estrategia de condensadores de salida híbridos: MLCC para el filtrado de ondulaciones de alta frecuencia (<1 MHz), SP-cap o POSCAP para el almacenamiento masivo de energía y la respuesta transitoria, condensadores de polímero para frecuencias intermedias
  • ✓Agregue un filtro pi (L-C-L) a la salida para aplicaciones de ondulación ultrabaja (<1 mV): el posregulador TI TPS7A8300 logra un ruido de 15 µV RMS después de SMPS
  • ✓Coloque los condensadores de salida a menos de 5 mm de los pines de alimentación del circuito integrado de carga: una longitud de traza de 10 mm agrega una inductancia parásita de 10 nH, lo que provoca un pico de 500 mV en un paso de carga de 50 A/µs

Errores Comunes

  • ✗Si se utilizan valores nominales de condensadores cerámicos: el X5R de 22 µF/6,3 V con una polarización de 1,0 V DC retiene solo entre el 60 y el 70% (13-15 µF efectivos); compruebe siempre las curvas de polarización de CC del fabricante o utilice el dieléctrico X7R
  • ✗Ignorar la ESR a alta frecuencia: la ESR electrolítica de aluminio aumenta de 2 a 5 veces de 100 Hz a 100 kHz; utilice la ESR de la hoja de datos a la frecuencia de conmutación, no a un valor de catálogo de 100 Hz
  • ✗Cálculo de la ondulación únicamente en condiciones nominales: la ondulación en el peor de los casos se produce en el ciclo de trabajo máximo (Vin mínimo) cuando la ondulación de la corriente del inductor es más alta

Preguntas Frecuentes

Según TI SLVA630, fuentes de ondulación: (1) Condensador de salida de carga/descarga de ondulación de corriente inductora — ΔVc = ΔIL/(8×fsw×C), (2) Condensador de salida ESR — ΔVesr = ΔIL × ESR, (3) Condensador de salida ESL en transiciones de conmutación — ΔVesl = ESL × dI/dt. A 500 kHz con condensadores cerámicos, la ondulación capacitiva suele contribuir entre un 70 y un 80%, la ESR entre un 15 y un 25% y la ESL entre un 5 y un 10%.
Según Analog Devices AN-1471: (1) Aumente la frecuencia de conmutación: duplique la ondulación de las mitades con los mismos valores de LC, (2) aumente la capacitancia de salida: reducción directamente proporcional, (3) utilice condensadores de baja ESR, MLCC cerámicos (2-10 mΩ) 0) versus electrolíticos (50-500 mΩ), (4) Aumente la inductancia, reduzca ΔIL , pero ralentice la respuesta transitoria, (5) Agregue posregulador: cordón de ferrita + El condensador o LDO proporciona una atenuación adicional de 40-60 dB.
Según los estándares del sector: cargas digitales (CPU, FPGA): < 1% de Vout (10 mV para un raíl de 1,0 V según las especificaciones de VRM de Intel/AMD). Circuitos analógicos/RF: < 0,1% (<3 mV para 3,3 V según las especificaciones del fabricante del ADC). Memoria (DDR4/5): ± 1,5% según el estándar JEDEC. Audio: <10 mV para evitar la degradación de la SNR de 60 dB. Controladores LED: se aceptan entre un 5 y un 20% para iluminación, < 2% para vídeos y fotografías.
La ondulación es inversamente proporcional a la frecuencia: ΔV ∝ 1/fsw. La duplicación de la frecuencia de 500 kHz a 1 MHz reduce a la mitad la ondulación con los mismos valores de LC, o habilita un inductor 2 veces más pequeño para la misma ondulación. Compensación: las pérdidas de conmutación aumentan proporcionalmente con la frecuencia. Según la guía de diseño de TI, la frecuencia óptima equilibra la eficiencia (favorece un FSW más bajo) con el tamaño/ondulación (favorece un FSW más alto), normalmente 200 kHz-2 MHz para los convertidores CC-CC.
Según las guías de aplicación de Murata y TDK, clasificadas según el rendimiento de ondulación: (1) cerámica MLCC (2-10 mΩ ESR, mejor rendimiento de HF, pero reducción de polarización de corriente continua y capacitancia volumétrica limitada), (2) polímero de aluminio (8-20 mΩ, buen equilibrio), (3) SP-Cap/POSCAP (5-15 mΩ, alta densidad de capacitancia), (4) tantalio (50-200 mΩ, sursur) clasificación geológica), (5) aluminio electrolítico (100-500 mΩ, el menor costo/tamaño para almacenamiento a granel, evite las ondulaciones de alta frecuencia).

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